LIÊN KẾT WEBSITE
Scheduling configuration memory error checks to improve the reliability of FPGA-based systems
IET COMPUTERS AND DIGITAL TECHNIQUES Số 3, năm 2019 (Tập 13, trang 154-165)
DOI: 10.1049/iet-cdt.2018.5001
Tài liệu thuộc danh mục: ISI
Article
English